1. 千兆以太网口设计看着简单坑比想象多千兆以太网口几乎是所有带网口的板卡标配但真正要把这个接口做稳、做过一致性测试、量产不翻车还真的不是照着参考设计连上线就完事的事。我见过太多“原理图照着芯片手册抄、Layout随便拉一拉”的项目结果要么高温下丢包率飙升要么打浪涌直接芯片报废要么过不了EMI预扫。这篇文章想讲的不是贴一堆芯片手册的引脚定义而是把千兆以太网从变压器选型到差分线走线的完整链路拆开说清楚每一步背后的“为什么”以及实际项目中踩过的坑和验证过的做法。不管你是刚入门画第一块带网口的板子还是已经被差分线等长搞到头大的老工程师这篇文章应该都能给你一些可以直接抄作业的东西。千兆以太网和百兆最大的区别就是它用了4对差分线同时收发每一对速率都在125MBaud加上PAM-5编码信号频率分量轻松跑到100MHz以上。这个频率段已经不是“连上就能通”的级别了PCB上任何一处阻抗不连续、参考平面断裂、等长偏差超标都会直接体现在眼图和误码率上。所以说白了千兆以太网口的设计本质上就是一次信号完整性的实战训练。2. 变压器选型这一颗料决定了你的物理层“下限”2.1 为什么网口非要放变压器很多刚入门的工程师不理解为什么PHY芯片出来的信号不能直接拉到RJ45座子上非要中间塞一个变压器。这个变压器的全名叫“以太网隔离变压器”或“网络变压器”它在链路里干三件事直流隔离PHY芯片侧和线缆侧完全直流隔离防止两端设备的地电位差形成环路电流同时避免外部浪涌直接灌进PHY。隔离耐压一般要求1500Vrms甚至更高这是安规层面的硬要求。共模抑制将线缆上耦合进来的共模干扰在变压器处隔离掉只让差模信号通过。收发端的地平面如果电位不同共模噪声会被变压器有效阻断。阻抗匹配与信号耦合变压器的匝数比和内部结构配合PHY的驱动能力完成线缆100Ω差分阻抗与PHY内部电路之间的匹配同时通过中心抽头提供PHY要求的直流偏置大多数PHY通过中心抽头给发送端供电。简单说变压器是PHY和外部世界的“防火墙翻译官”。没有它PHY芯片的ESD和浪涌耐受能力会差好几个数量级而且共模噪声会让接收端完全没法正确解析信号。2.2 分离式还是集成式两种方案的取舍变压器在工程实现上有两种主流形态对比项分离式变压器 普通RJ45集成变压器RJ45带磁性RJ45布局面积占用更大变压器和座子分开放一体化节省PCB面积差分线走线PHY→变压器→RJ45两段链路都要管PHY直接到RJ45走线更短成本分开采购成本略低单颗料集成物料成本略高灵活性变压器型号可选范围大座子选型受限替换不便量产一致性受两个器件的焊接与一致性叠加影响单一器件一致性相对好维修调试可单独更换坏一个换一个总成从我实际项目经验看如果板卡结构允许、成本敏感、且Layout空间够我倾向分离式方案因为调试时可以单独更换变压器排查问题。如果是空间极紧凑的产品比如小路由、IP Cam、工业小模块集成RJ45更省心少一截走线等于少一段风险。还有一类方案是部分PHY厂商参考设计里推荐的“共模电感 变压器”组合原理图上会在变压器和RJ45之间再放一个共模电感Common Mode Choke。这东西对改善辐射和抗共模干扰很有帮助但也不是非加不可。主流做法是选变压器时直接选内含共模电感结构的料比如某些带自耦合线圈结构的网络变压器就不再额外加CMC。2.3 选型时真正要盯住的几个参数选变压器不能光看“是不是千兆的”。我建议至少把下面几个参数翻出来看匝数比Turns Ratio千兆以太网变压器通常1:1发送和接收都一样。有些专用PHY会要求特殊变比选型必须跟PHY手册对表。插入损耗Insertion Loss100MHz下插损要尽量小典型值1dB以内好的料能做到0.5dB上下。插损大直接吃掉信号裕量。回波损耗Return Loss表征100Ω差分阻抗匹配度。100MHz下一般要求-16dB以下频率越高要求越难满足。回波差意味着反射大反射叠加后会造成眼图闭合。共模抑制比CMRR衡量变压器对共模噪声的抑制能力通常要求30dB以上100MHz。共模抑制不够线缆耦合的共模干扰会漏进PHY接收端。隔离耐压常规要求1500Vrms用于AC供电设备的话建议选更高等级的隔离比如2000Vrms以上的料。选型还有一个容易忽略的点变压器的工作温度和带宽老化特性。工业级产品建议选宽温型号不要拿商业级的料去硬扛-40℃环境。2.4 中心抽头的处理参考设计和你的电路谁对每家PHY的参考设计在变压器中心抽头Center Tap接法上都有讲究常见的有接电源、接电容到地、或者直接接特定电平。这里一定要严格跟着PHY手册走不要自作聪明地“优化”。常见的两种发送侧中心抽头很多PHY要求通过中心抽头给发送端供电或者接一个对地电容比如0.1µF来做共模噪声去耦。如果手册标注了电源电压和去耦电容值照抄并放一个靠近变压器引脚的高频退藕电容。接收侧中心抽头通常接一个RC到地用来设置接收共模电平和滤除共模噪声。RC的值在PHY手册里有推荐有些PHY也允许直接接固定电平。我在实际项目里见过接收侧中心抽头虚焊导致丢包偶发的情况排查了很久最后发现是生产时电容贴歪导致虚焊。这种细节看起来不起眼一旦批量起来就是千分之几的坏品率。3. 千兆以太网PCB布局先定架构再画线3.1 布局前必须想清楚的链路顺序千兆以太网的信号链路是PHY芯片 → 滤波/匹配网络RC或共模电感→ 变压器 → 共模抑制/ESD防护 → RJ45座子 → 网线。PCB布局的核心目标是用最短路径、最干净的参考平面把这段链路安排好。我习惯在布局前干三件事把PHY芯片、变压器、RJ45的相对位置确定下来。RJ45在板边是硬要求因为要插线缆PHY和变压器紧跟其后形成一条尽量直的“信号走廊”。不要让信号在板子上绕弯更不要绕到板内去。确定变压器下方的铺铜处理。这里有个经典分歧变压器下方要不要铺地。我个人的做法是在变压器真正的信号引脚正下方不铺实心铜但把变压器隔离带两侧的地平面分开管理。更简单可靠的做法是参考PHY厂商的参考设计如果参考设计里变压器下方预留了净空区就按净空区处理如果参考设计里铺了地就铺地并打满过孔做缝合。核心目的是避免变压器内部线圈的噪声直接耦合到参考平面。隔离带上禁布其他信号。变压器通常有初级侧PHY侧和次级侧线缆侧两边的地平面不要直接大面积相连通常通过跨接电容高压电容做交流耦合或者干脆留窄缝。初级侧的地就是PGND次级侧的地是线缆侧的“大地”两边在靠近RJ45的安装孔附近通过螺钉和机壳接在一起。这个概念叫隔离带Isolation Barrier在AC供电的产品里尤其重要。3.2 从PHY到变压器的扇出切记“短、直、对称”PHY芯片的引脚很多千兆网口相关的差分对通常分布在芯片一侧。扇出时要注意差分对从PHY出来之后到变压器之前不要换层。这个区间的线很短但如果为了绕线方便换层打了两个过孔等于在这个链路最敏感的地方加了两个阻抗不连续点。实测下来过孔造成的反射在低速下感觉不到在千兆下就是眼图边缘的毛刺。PHY侧的RC匹配网络要贴着PHY放。很多PHY要求发送端串电阻如22Ω/33Ω或并联RC到地这些电阻电容一定要靠近PHY引脚而不是靠近变压器否则没起到阻抗匹配的作用。4对差分线之间留出空间。千兆以太网4对线同时工作相邻对之间会有串扰。建议相邻差分对间拉开的距离不小于30mil或者中间走地线隔离。条件允许的话错开布线alternate routing也有帮助。3.3 电源和地平面的处理没铺好地线画得再好也白搭千兆以太网的PHY通常有独立的模拟电源引脚AVDD和数字电源引脚DVDD甚至有多路1.0V/1.8V/2.5V电压域。网络变压器和PHY附近的电源去耦直接影响信号的纯净度。实际项目中我比较注意几点PHY下方的电源平面完整体不要让其他信号线从PHY下方的电源平面上直接跨过尤其是不要有大电流的DC-DC开关节点穿过。去耦电容按频段分级在PHY电源引脚旁边放0.1µF高频去耦和1µF/10µF储能电容布局上从小到大靠近引脚。高频去耦电容离PHY引脚要近走线要尽量短最好是引脚出线直接打过孔到电容再到平面。变压器中心抽头旁边的电容无论是接电源还是接地这个电容都要靠近变压器的中心抽头引脚不要远放。这几个电容往往容易被Layout工程师忽略直接“随便找个空位放”结果就是共模噪声滤不干净。有一次项目里接收端误码率偏高排查到最后发现是PHY模拟电源的0.1µF电容被放到了板子背面、走线绕了两个过孔才到引脚等效串联电感变大高频去耦完全失效。把电容挪到正面贴引脚之后误码率肉眼可见地下降。所以去耦电容不打折位置就是一切。4. 差分线走线技巧心中有阻抗手上才有数4.1 为什么千兆非得较真100Ω差分阻抗差分线的核心指标是差分阻抗千兆以太网要求TX/RX差分对的差分阻抗为100Ω±10%。这个指标直接决定了信号反射、振铃和辐射水平。打个比方差分线就是一条“信号水管”PHY是水泵RJ45那边是出水口。管径线宽线距和参考平面关系决定了水流阻力阻抗。如果水管中间有一截管径突然变细阻抗突变水流会在那里形成回涌反射回涌会冲乱后面的水流信号质量恶化。计算100Ω差分阻抗的公式是软件的事但工程师心里要有数差分阻抗主要取决于线宽、线距、参考平面距离介质厚度、介电常数。同一层上线宽越宽、离参考平面越近阻抗越低线距越近耦合越强但也别指望靠调线距来大幅调阻抗——在表层差分线中线距对阻抗的影响远不如线宽和介质厚度来得大。推荐做法是先跟板厂确认叠层结构算出具体线宽线距再留出阻抗调整的空间。不要用网络上一个“通用”的8/8mil规则套所有板子。不同叠层、不同板厚、不同板材千兆以太网差分线的线宽线距可能是8/8mil也可能是6/6mil甚至5/8mil差别很大。来看一个典型4层板叠层的例子参数表层信号内层信号层结构L1信号 / L2地L2地 / L3信号介质厚度到参考平面3.5milPP4.2mil芯板板材FR-4Dk≈4.21GHzFR-4目标差分阻抗100Ω100Ω推荐线宽/线距6mil / 8mil6mil / 7mil等长偏差目标±5mil±5mil这个表只是示例每家的叠层都不一样最忌“叠层不告诉板厂让板厂自己算阻抗”因板厂默认参数和你实际叠层不一致出来的阻抗往往偏差很大。正确做法是把叠层结构作为阻抗计算的核心输入自己算一遍再把要求阻抗值、线宽、线距写在制板说明里让板厂复核。4.2 差分对的走线规则不是只有“等长”这一件事等长当然重要但很多人一提到差分线就只想到等长忽略了其他同样关键的点。间距Coupling同一差分对内P和N的间距要恒定。不要一会儿近一会儿远否则会引入共模转换和阻抗变化。建议两线之间的间距差控制在2mil以内。对间间距Isolation不同差分对之间的间距尽量保持3倍线宽以上也就是≥18mil用30mil更安全。如果空间实在紧张至少也要保证12mil以上然后加地孔隔离。避免跨分割差分对下方必须有连续的参考平面绝不能让信号跨过电源平面分割区域或地平面缝隙。跨分割的直接后果是阻抗突变回流路径被迫绕路辐射和串扰同步恶化。这在市面上很多“低成本的2层板”方案里很难完全避免但如果做4层板还跨分割就说不过去了。过孔要成对如果必须换层两个过孔尽量靠近放置并在换层附近加地孔伴随。过孔本身会带来约几皮法的寄生电容导致阻抗偏低成对的地孔能稍微缓解回流路径不连续的问题。不要悬空的stub任何差分线上的分支、测试点、过孔焊盘的未使用段都会形成stub。Stub在GHz级别下就是一根天线千兆下已经能产生影响。所以测试点要么不放要么放在一个不影响主链路的叠层位置。4.3 千兆差分对的等长控制到底要做到多少等长的本质是保证P和N两条线的时间偏差skew足够小。千兆以太网用的是PAM-5编码单线速率125MBaud周期是8ns。理论上只要差分对内部skew相对于信号的上升沿约0.5ns~1ns足够小就行。我的经验目标是对内等长P与N之间≤5mil对应约0.4ps/mil的速度差5mil约等于2ps的skew。这个量级对于千兆来说非常安全甚至可以说有点保守了。但板材不均匀、邻近干扰等因素会在实际中放大偏差所以宁严勿松。对间等长4对线之间≤25mil也就是TX和TX-这对与RX和RX-那对之间的长度差不超过25mil。千兆PHY内部有时钟恢复机制和FIFO缓冲来容纳一定skew但对间差太大会导致接收端采样窗口变小。25mil是一个比较稳妥的经验值。做等长的时候绕线蛇形线的走法有讲究绕线段的长度也就是绕线每个蛇形段的幅值不要太大避免产生过多的段间串扰。建议蛇形线的间距至少满足3倍线宽比如线宽6mil蛇形线段的间距至少20mil同一段绕线尽量用连续圆弧或45°角不要用90°直角。另外也要注意绕线不要绕在靠近PHY芯片或变压器引脚的位置因为那里的空间本来就紧张绕线容易造成局部间距突变。4.4 实操AD里怎么给差分线做条件等长对应热搜“ad怎么条件差分线长度”很多朋友在Altium Designer里画差分线最头疼的就是“我明明设了等长为什么绕线的时候它不给提示”“差分线长度怎么调才能正好符合目标”。这里我把AD里的做法整理一下。第一步在规则里把差分对规则设好Design → Rules → High Speed → Differential Pairs。这里要设置Min/Max/Preferred Gap线距单位mil比如设Min6Max10Preferred8。Min/Max/Preferred Width线宽比如设Min5Max7Preferred6。另外还有一个Match Length等长目标的规则在High Speed → Matched Length里可以设置组目标比如设置为1000mil或者直接按差分对工具的实时指示来绕线。第二步交互式差分对布线快捷键是PMPlace → Interactive Differential Pair Routing或者用工具栏里的差分对布线按钮。布线时会自动按照规则中的线宽线距走线且P和N会同时放下。第三步长度调谐让AD自动帮你调整等长在布线完成后选中一对差分线执行Tools → Length Tuning或者快捷键TU。AD会弹出一个调谐操作界面让你选择绕线方式Accordion、Trombone、Sawtooth等并设定目标长度。此时AD会高亮显示出这根线的实际长度和目标长度的差值。手动绕线时要注意AD的长度数据是实时更新的当你拖动蛇形线段时可以在状态栏或Preferences里打开“Display Delays”显示实时长度。绕完后按一下快捷键ShiftCtrlD切换差分对长度信息显示就能看到每一对的Length和支路差。如果遇到“Mitered”或“Arc”选项优先用“Arc”或“Mitered”因为圆弧绕线在高频下比尖锐的直角蛇形线更友好。虽然45°角也不会致命但圆弧的阻抗连续性好一点。第四步自动检查最后用Design → Rules Check跑一遍确认High Speed规则都满足。这里建议把报错严重级别调低一些因为有些规则比如层间skew在低速板上不适用但Differential Pair相关的规则必须设成Fatal或Error级别确保不放过。4.5 差分信号的高值和低值以LVDS为例说明对应热搜“lvds的差分线高值和低值”热搜词里还有一个“lvds的差分线高值和低值”看起来是有人混淆了LVDS电气参数。我顺便把差分信号的高值低值概念说清楚因为在网口调试里也会遇到类似的电平测量问题。差分信号不是“一根线3.3V一根线0V”这样的单端概念。LVDS低压差分信号的标准是驱动器输出差分电压摆幅Vod在250mV~450mV之间典型值350mV。这个“高值”和“低值”通常指的是差分对的P端和N端之间的压差P端电压高于N端即Vp-Vn为正值且大于接收阈值时逻辑为“1”P端电压低于N端即Vp-Vn为负值时逻辑为“0”。LVDS还有一个“共模电压”的概念即(PN)/2典型值为1.2V左右。它表示P和N之间共同的那个直流偏置是在测量差分信号时必须同时关注的量。跑偏到千兆以太网虽然以太网用的是MLT-3/PAM-5编码不是标准的LVDS电平但PHY芯片的MDI差分引脚同样有明确的差分电压规范。调试中如果测到P和N之间压差很小比如小于100mV常见原因是变压器初级侧断路、中心抽头虚焊或者PHY没有正确配置发送电平。这时用示波器看P和N之间的差分波形比分别看单端波形更直观。5. 常见问题与排查技巧实录这些问题我几乎都踩过5.1 症状一能link上但大流量丢包现象插上网线链路指示灯正常局域网ping也通但跑iperf大流量时丢包率飙升甚至直接断流。排查思路先看物理层在PHY芯片管脚处用示波器看RX差分对的眼图。如果眼图张开得不够清晰边缘抖动大优先怀疑差分阻抗不匹配或等长偏差过大。再查接收端信号幅度在变压器次级侧靠近RJ45那一侧测差分信号幅度如果幅度偏低怀疑变压器插损过大或PHY发送驱动强度配置不对。有些PHY支持调整发送幅度一般在驱动寄存器里可以配置。如果幅度和眼图都不错但还是丢包查软件中断与FIFO配置。千兆网卡丢包问题很多时候其实是驱动的环形缓冲区太小或中断合并策略不当跟硬件关系不大别一头扎进Layout里出不来。5.2 症状二过EMI预扫时网口附近辐射超标现象辐射测试在125MHz或250MHz频点超标。125MHz刚好是千兆单线符号率出现这类频点超标时基本可以确定是布线或参考平面问题而不是软件误报。排查思路检查差分对与地平面的距离如果差分线离参考平面太远表层介质厚度过大辐射就会偏大。表层走线的辐射通常比内层走线大1~2个数量级所以信号完整性和EMI敏感的板子优先把千兆差分对走内层。检查变压器下方净空如果变压器下方铺铜方式不当变压器内部线圈的电场会直接辐射到PCB边缘。建议按“隔离带下方清空或严格按参考设计铺铜”来处理。检查RJ45金属壳接地多数RJ45带屏蔽外壳shield屏蔽壳要直接或通过阻容到机壳地。如果外壳悬空线缆上的共模电流会从RJ45座子直接辐射出来。这里注意屏蔽壳接地方案直接接还是通过1nF/2kV电容接取决于产品设计但绝不能不接。5.3 症状三高温老化后偶尔丢失物理链路现象高温箱里跑了几个小时网口偶尔link down然后自动恢复或者恢复后速度从1Gbps降到100Mbps。这种“半高不低”的问题最折磨人我遇到过两次。一次是PHY芯片的以太网变压器次级侧到RJ45之间的一颗共模电感虚焊。温度上来后焊点阻抗漂移共模抑制性能下降接收端误码率增加PHY自动协商降到100M。重新焊接后恢复正常。另一次是变压器中心抽头去耦电容的耐压不够高温低压下漏电增大导致共模电平偏移。这个坑比较隐蔽因为常温下没问题老化后才复发。排查建议高温现象优先做“点温”测试用热像仪看PHY附近和变压器附近的发热是否集中异常。很多隐蔽问题都是热应力引发了不良焊点或器件参数漂移。5.4 症状四量产时有千分之几的板子网口不通量产的偶发不良基本都是制造环节的问题。常见原因包括差分对钻孔偏差导致阻抗偏大/偏小板厂在制板时如果线宽线距控制不稳第一批能做准第二批就漂了。对策是要求板厂在关键层做阻抗测试条coupon出货报告里必须包含阻抗实测值和测试位置。变压器焊接偏移分离式变压器引脚间距小贴片偏移后导致开路或短路。对策是把变压器封装加长定位焊盘同时在炉后AOI里单独检查变压器本体位置。RJ45座子的金属脚虚焊这种问题外观上看不出来但插上网线时弹片接触力差时通时断。对策是要求RJ45供应商提供伸缩寿命测试报告并确保PCB上的焊盘开孔尺寸匹配座子的鱼眼/弹针结构。量产问题排查有个经验第一次拿到不良板先别急着换料调试做一次“最小化干预”——补焊所有关键引脚变压器、RJ45、PHY如果故障消失大概率是焊接问题如果故障还在再怀疑Layout或器件问题。这个方法能省很多时间。5.5 关于调试工具的一点建议调试千兆以太网口示波器带宽至少500MHz1GHz更好。如果没有差分探头可以用两个同型号探头分别接P和N然后在示波器上用数学通道做减法得到差分波形。但要注意探头本身的延迟和幅度失配会引入误差建议选用匹配好的探头对。时域反射计TDR是排查阻抗不连续的利器但一般团队不一定有。退而求其次可以用矢量网络分析仪VNA测回波损耗或者直接用PHY内部的PRBS自检模式来检测接收质量。很多千兆PHY支持回环测试Loopback配合上位机软件能快速判断链路好坏。6. 最后分享一个小经验参考设计也要带着怀疑去看很多工程师画网络接口习惯“PHY参考设计怎么画我就怎么画参考设计怎么布局我就怎么排”。这话对了一半。参考设计是芯片厂商经过验证的方案当然可信度很高但它有一个隐含前提参考设计的叠层、板材、Layout空间、滤波网络都是跟它自家的demo板绑定的。你换了一个叠层或者换了一颗变压器有一部分细节就不再适用了。比如参考设计里变压器下方铺铜但你的板子叠层更薄此时变压器下方的铺铜方式可能就需要重新评估。我的习惯是拿到参考设计后先画一个“为什么这个元件放在这里”的草图把每个去耦电容、每个匹配电阻、每段走线的目的标出来然后结合自己的叠层和结构重新布置。这样虽然前期花点时间但后面调试和量产的时候你会觉得特别有底。另外如果你用的是集成RJ45的变压器方案务必确认你选的那颗座子内部变压器的型号和PHY的匹配性。有些“万金油”座子内部集成的变压器在125MHz附近的插损偏高视觉效果上能协商上千兆但长时间高速传输时会丢包换一颗同封装但内部用更好磁芯的座子问题就消失了。千兆以太网口设计这件事本质上是把信号完整性的基本功练一遍。变压器选型解决的是“链路的下限”差分线走线解决的是“链路的上限”量产可靠性决定了你这个项目能不能真正落地。把这三个层次都做扎实你画的网口就不会再成为项目里的“玄学问题”。 千兆以太网口设计实战：从变压器选型到差分走线全解析
1. 千兆以太网口设计看着简单坑比想象多千兆以太网口几乎是所有带网口的板卡标配但真正要把这个接口做稳、做过一致性测试、量产不翻车还真的不是照着参考设计连上线就完事的事。我见过太多“原理图照着芯片手册抄、Layout随便拉一拉”的项目结果要么高温下丢包率飙升要么打浪涌直接芯片报废要么过不了EMI预扫。这篇文章想讲的不是贴一堆芯片手册的引脚定义而是把千兆以太网从变压器选型到差分线走线的完整链路拆开说清楚每一步背后的“为什么”以及实际项目中踩过的坑和验证过的做法。不管你是刚入门画第一块带网口的板子还是已经被差分线等长搞到头大的老工程师这篇文章应该都能给你一些可以直接抄作业的东西。千兆以太网和百兆最大的区别就是它用了4对差分线同时收发每一对速率都在125MBaud加上PAM-5编码信号频率分量轻松跑到100MHz以上。这个频率段已经不是“连上就能通”的级别了PCB上任何一处阻抗不连续、参考平面断裂、等长偏差超标都会直接体现在眼图和误码率上。所以说白了千兆以太网口的设计本质上就是一次信号完整性的实战训练。2. 变压器选型这一颗料决定了你的物理层“下限”2.1 为什么网口非要放变压器很多刚入门的工程师不理解为什么PHY芯片出来的信号不能直接拉到RJ45座子上非要中间塞一个变压器。这个变压器的全名叫“以太网隔离变压器”或“网络变压器”它在链路里干三件事直流隔离PHY芯片侧和线缆侧完全直流隔离防止两端设备的地电位差形成环路电流同时避免外部浪涌直接灌进PHY。隔离耐压一般要求1500Vrms甚至更高这是安规层面的硬要求。共模抑制将线缆上耦合进来的共模干扰在变压器处隔离掉只让差模信号通过。收发端的地平面如果电位不同共模噪声会被变压器有效阻断。阻抗匹配与信号耦合变压器的匝数比和内部结构配合PHY的驱动能力完成线缆100Ω差分阻抗与PHY内部电路之间的匹配同时通过中心抽头提供PHY要求的直流偏置大多数PHY通过中心抽头给发送端供电。简单说变压器是PHY和外部世界的“防火墙翻译官”。没有它PHY芯片的ESD和浪涌耐受能力会差好几个数量级而且共模噪声会让接收端完全没法正确解析信号。2.2 分离式还是集成式两种方案的取舍变压器在工程实现上有两种主流形态对比项分离式变压器 普通RJ45集成变压器RJ45带磁性RJ45布局面积占用更大变压器和座子分开放一体化节省PCB面积差分线走线PHY→变压器→RJ45两段链路都要管PHY直接到RJ45走线更短成本分开采购成本略低单颗料集成物料成本略高灵活性变压器型号可选范围大座子选型受限替换不便量产一致性受两个器件的焊接与一致性叠加影响单一器件一致性相对好维修调试可单独更换坏一个换一个总成从我实际项目经验看如果板卡结构允许、成本敏感、且Layout空间够我倾向分离式方案因为调试时可以单独更换变压器排查问题。如果是空间极紧凑的产品比如小路由、IP Cam、工业小模块集成RJ45更省心少一截走线等于少一段风险。还有一类方案是部分PHY厂商参考设计里推荐的“共模电感 变压器”组合原理图上会在变压器和RJ45之间再放一个共模电感Common Mode Choke。这东西对改善辐射和抗共模干扰很有帮助但也不是非加不可。主流做法是选变压器时直接选内含共模电感结构的料比如某些带自耦合线圈结构的网络变压器就不再额外加CMC。2.3 选型时真正要盯住的几个参数选变压器不能光看“是不是千兆的”。我建议至少把下面几个参数翻出来看匝数比Turns Ratio千兆以太网变压器通常1:1发送和接收都一样。有些专用PHY会要求特殊变比选型必须跟PHY手册对表。插入损耗Insertion Loss100MHz下插损要尽量小典型值1dB以内好的料能做到0.5dB上下。插损大直接吃掉信号裕量。回波损耗Return Loss表征100Ω差分阻抗匹配度。100MHz下一般要求-16dB以下频率越高要求越难满足。回波差意味着反射大反射叠加后会造成眼图闭合。共模抑制比CMRR衡量变压器对共模噪声的抑制能力通常要求30dB以上100MHz。共模抑制不够线缆耦合的共模干扰会漏进PHY接收端。隔离耐压常规要求1500Vrms用于AC供电设备的话建议选更高等级的隔离比如2000Vrms以上的料。选型还有一个容易忽略的点变压器的工作温度和带宽老化特性。工业级产品建议选宽温型号不要拿商业级的料去硬扛-40℃环境。2.4 中心抽头的处理参考设计和你的电路谁对每家PHY的参考设计在变压器中心抽头Center Tap接法上都有讲究常见的有接电源、接电容到地、或者直接接特定电平。这里一定要严格跟着PHY手册走不要自作聪明地“优化”。常见的两种发送侧中心抽头很多PHY要求通过中心抽头给发送端供电或者接一个对地电容比如0.1µF来做共模噪声去耦。如果手册标注了电源电压和去耦电容值照抄并放一个靠近变压器引脚的高频退藕电容。接收侧中心抽头通常接一个RC到地用来设置接收共模电平和滤除共模噪声。RC的值在PHY手册里有推荐有些PHY也允许直接接固定电平。我在实际项目里见过接收侧中心抽头虚焊导致丢包偶发的情况排查了很久最后发现是生产时电容贴歪导致虚焊。这种细节看起来不起眼一旦批量起来就是千分之几的坏品率。3. 千兆以太网PCB布局先定架构再画线3.1 布局前必须想清楚的链路顺序千兆以太网的信号链路是PHY芯片 → 滤波/匹配网络RC或共模电感→ 变压器 → 共模抑制/ESD防护 → RJ45座子 → 网线。PCB布局的核心目标是用最短路径、最干净的参考平面把这段链路安排好。我习惯在布局前干三件事把PHY芯片、变压器、RJ45的相对位置确定下来。RJ45在板边是硬要求因为要插线缆PHY和变压器紧跟其后形成一条尽量直的“信号走廊”。不要让信号在板子上绕弯更不要绕到板内去。确定变压器下方的铺铜处理。这里有个经典分歧变压器下方要不要铺地。我个人的做法是在变压器真正的信号引脚正下方不铺实心铜但把变压器隔离带两侧的地平面分开管理。更简单可靠的做法是参考PHY厂商的参考设计如果参考设计里变压器下方预留了净空区就按净空区处理如果参考设计里铺了地就铺地并打满过孔做缝合。核心目的是避免变压器内部线圈的噪声直接耦合到参考平面。隔离带上禁布其他信号。变压器通常有初级侧PHY侧和次级侧线缆侧两边的地平面不要直接大面积相连通常通过跨接电容高压电容做交流耦合或者干脆留窄缝。初级侧的地就是PGND次级侧的地是线缆侧的“大地”两边在靠近RJ45的安装孔附近通过螺钉和机壳接在一起。这个概念叫隔离带Isolation Barrier在AC供电的产品里尤其重要。3.2 从PHY到变压器的扇出切记“短、直、对称”PHY芯片的引脚很多千兆网口相关的差分对通常分布在芯片一侧。扇出时要注意差分对从PHY出来之后到变压器之前不要换层。这个区间的线很短但如果为了绕线方便换层打了两个过孔等于在这个链路最敏感的地方加了两个阻抗不连续点。实测下来过孔造成的反射在低速下感觉不到在千兆下就是眼图边缘的毛刺。PHY侧的RC匹配网络要贴着PHY放。很多PHY要求发送端串电阻如22Ω/33Ω或并联RC到地这些电阻电容一定要靠近PHY引脚而不是靠近变压器否则没起到阻抗匹配的作用。4对差分线之间留出空间。千兆以太网4对线同时工作相邻对之间会有串扰。建议相邻差分对间拉开的距离不小于30mil或者中间走地线隔离。条件允许的话错开布线alternate routing也有帮助。3.3 电源和地平面的处理没铺好地线画得再好也白搭千兆以太网的PHY通常有独立的模拟电源引脚AVDD和数字电源引脚DVDD甚至有多路1.0V/1.8V/2.5V电压域。网络变压器和PHY附近的电源去耦直接影响信号的纯净度。实际项目中我比较注意几点PHY下方的电源平面完整体不要让其他信号线从PHY下方的电源平面上直接跨过尤其是不要有大电流的DC-DC开关节点穿过。去耦电容按频段分级在PHY电源引脚旁边放0.1µF高频去耦和1µF/10µF储能电容布局上从小到大靠近引脚。高频去耦电容离PHY引脚要近走线要尽量短最好是引脚出线直接打过孔到电容再到平面。变压器中心抽头旁边的电容无论是接电源还是接地这个电容都要靠近变压器的中心抽头引脚不要远放。这几个电容往往容易被Layout工程师忽略直接“随便找个空位放”结果就是共模噪声滤不干净。有一次项目里接收端误码率偏高排查到最后发现是PHY模拟电源的0.1µF电容被放到了板子背面、走线绕了两个过孔才到引脚等效串联电感变大高频去耦完全失效。把电容挪到正面贴引脚之后误码率肉眼可见地下降。所以去耦电容不打折位置就是一切。4. 差分线走线技巧心中有阻抗手上才有数4.1 为什么千兆非得较真100Ω差分阻抗差分线的核心指标是差分阻抗千兆以太网要求TX/RX差分对的差分阻抗为100Ω±10%。这个指标直接决定了信号反射、振铃和辐射水平。打个比方差分线就是一条“信号水管”PHY是水泵RJ45那边是出水口。管径线宽线距和参考平面关系决定了水流阻力阻抗。如果水管中间有一截管径突然变细阻抗突变水流会在那里形成回涌反射回涌会冲乱后面的水流信号质量恶化。计算100Ω差分阻抗的公式是软件的事但工程师心里要有数差分阻抗主要取决于线宽、线距、参考平面距离介质厚度、介电常数。同一层上线宽越宽、离参考平面越近阻抗越低线距越近耦合越强但也别指望靠调线距来大幅调阻抗——在表层差分线中线距对阻抗的影响远不如线宽和介质厚度来得大。推荐做法是先跟板厂确认叠层结构算出具体线宽线距再留出阻抗调整的空间。不要用网络上一个“通用”的8/8mil规则套所有板子。不同叠层、不同板厚、不同板材千兆以太网差分线的线宽线距可能是8/8mil也可能是6/6mil甚至5/8mil差别很大。来看一个典型4层板叠层的例子参数表层信号内层信号层结构L1信号 / L2地L2地 / L3信号介质厚度到参考平面3.5milPP4.2mil芯板板材FR-4Dk≈4.21GHzFR-4目标差分阻抗100Ω100Ω推荐线宽/线距6mil / 8mil6mil / 7mil等长偏差目标±5mil±5mil这个表只是示例每家的叠层都不一样最忌“叠层不告诉板厂让板厂自己算阻抗”因板厂默认参数和你实际叠层不一致出来的阻抗往往偏差很大。正确做法是把叠层结构作为阻抗计算的核心输入自己算一遍再把要求阻抗值、线宽、线距写在制板说明里让板厂复核。4.2 差分对的走线规则不是只有“等长”这一件事等长当然重要但很多人一提到差分线就只想到等长忽略了其他同样关键的点。间距Coupling同一差分对内P和N的间距要恒定。不要一会儿近一会儿远否则会引入共模转换和阻抗变化。建议两线之间的间距差控制在2mil以内。对间间距Isolation不同差分对之间的间距尽量保持3倍线宽以上也就是≥18mil用30mil更安全。如果空间实在紧张至少也要保证12mil以上然后加地孔隔离。避免跨分割差分对下方必须有连续的参考平面绝不能让信号跨过电源平面分割区域或地平面缝隙。跨分割的直接后果是阻抗突变回流路径被迫绕路辐射和串扰同步恶化。这在市面上很多“低成本的2层板”方案里很难完全避免但如果做4层板还跨分割就说不过去了。过孔要成对如果必须换层两个过孔尽量靠近放置并在换层附近加地孔伴随。过孔本身会带来约几皮法的寄生电容导致阻抗偏低成对的地孔能稍微缓解回流路径不连续的问题。不要悬空的stub任何差分线上的分支、测试点、过孔焊盘的未使用段都会形成stub。Stub在GHz级别下就是一根天线千兆下已经能产生影响。所以测试点要么不放要么放在一个不影响主链路的叠层位置。4.3 千兆差分对的等长控制到底要做到多少等长的本质是保证P和N两条线的时间偏差skew足够小。千兆以太网用的是PAM-5编码单线速率125MBaud周期是8ns。理论上只要差分对内部skew相对于信号的上升沿约0.5ns~1ns足够小就行。我的经验目标是对内等长P与N之间≤5mil对应约0.4ps/mil的速度差5mil约等于2ps的skew。这个量级对于千兆来说非常安全甚至可以说有点保守了。但板材不均匀、邻近干扰等因素会在实际中放大偏差所以宁严勿松。对间等长4对线之间≤25mil也就是TX和TX-这对与RX和RX-那对之间的长度差不超过25mil。千兆PHY内部有时钟恢复机制和FIFO缓冲来容纳一定skew但对间差太大会导致接收端采样窗口变小。25mil是一个比较稳妥的经验值。做等长的时候绕线蛇形线的走法有讲究绕线段的长度也就是绕线每个蛇形段的幅值不要太大避免产生过多的段间串扰。建议蛇形线的间距至少满足3倍线宽比如线宽6mil蛇形线段的间距至少20mil同一段绕线尽量用连续圆弧或45°角不要用90°直角。另外也要注意绕线不要绕在靠近PHY芯片或变压器引脚的位置因为那里的空间本来就紧张绕线容易造成局部间距突变。4.4 实操AD里怎么给差分线做条件等长对应热搜“ad怎么条件差分线长度”很多朋友在Altium Designer里画差分线最头疼的就是“我明明设了等长为什么绕线的时候它不给提示”“差分线长度怎么调才能正好符合目标”。这里我把AD里的做法整理一下。第一步在规则里把差分对规则设好Design → Rules → High Speed → Differential Pairs。这里要设置Min/Max/Preferred Gap线距单位mil比如设Min6Max10Preferred8。Min/Max/Preferred Width线宽比如设Min5Max7Preferred6。另外还有一个Match Length等长目标的规则在High Speed → Matched Length里可以设置组目标比如设置为1000mil或者直接按差分对工具的实时指示来绕线。第二步交互式差分对布线快捷键是PMPlace → Interactive Differential Pair Routing或者用工具栏里的差分对布线按钮。布线时会自动按照规则中的线宽线距走线且P和N会同时放下。第三步长度调谐让AD自动帮你调整等长在布线完成后选中一对差分线执行Tools → Length Tuning或者快捷键TU。AD会弹出一个调谐操作界面让你选择绕线方式Accordion、Trombone、Sawtooth等并设定目标长度。此时AD会高亮显示出这根线的实际长度和目标长度的差值。手动绕线时要注意AD的长度数据是实时更新的当你拖动蛇形线段时可以在状态栏或Preferences里打开“Display Delays”显示实时长度。绕完后按一下快捷键ShiftCtrlD切换差分对长度信息显示就能看到每一对的Length和支路差。如果遇到“Mitered”或“Arc”选项优先用“Arc”或“Mitered”因为圆弧绕线在高频下比尖锐的直角蛇形线更友好。虽然45°角也不会致命但圆弧的阻抗连续性好一点。第四步自动检查最后用Design → Rules Check跑一遍确认High Speed规则都满足。这里建议把报错严重级别调低一些因为有些规则比如层间skew在低速板上不适用但Differential Pair相关的规则必须设成Fatal或Error级别确保不放过。4.5 差分信号的高值和低值以LVDS为例说明对应热搜“lvds的差分线高值和低值”热搜词里还有一个“lvds的差分线高值和低值”看起来是有人混淆了LVDS电气参数。我顺便把差分信号的高值低值概念说清楚因为在网口调试里也会遇到类似的电平测量问题。差分信号不是“一根线3.3V一根线0V”这样的单端概念。LVDS低压差分信号的标准是驱动器输出差分电压摆幅Vod在250mV~450mV之间典型值350mV。这个“高值”和“低值”通常指的是差分对的P端和N端之间的压差P端电压高于N端即Vp-Vn为正值且大于接收阈值时逻辑为“1”P端电压低于N端即Vp-Vn为负值时逻辑为“0”。LVDS还有一个“共模电压”的概念即(PN)/2典型值为1.2V左右。它表示P和N之间共同的那个直流偏置是在测量差分信号时必须同时关注的量。跑偏到千兆以太网虽然以太网用的是MLT-3/PAM-5编码不是标准的LVDS电平但PHY芯片的MDI差分引脚同样有明确的差分电压规范。调试中如果测到P和N之间压差很小比如小于100mV常见原因是变压器初级侧断路、中心抽头虚焊或者PHY没有正确配置发送电平。这时用示波器看P和N之间的差分波形比分别看单端波形更直观。5. 常见问题与排查技巧实录这些问题我几乎都踩过5.1 症状一能link上但大流量丢包现象插上网线链路指示灯正常局域网ping也通但跑iperf大流量时丢包率飙升甚至直接断流。排查思路先看物理层在PHY芯片管脚处用示波器看RX差分对的眼图。如果眼图张开得不够清晰边缘抖动大优先怀疑差分阻抗不匹配或等长偏差过大。再查接收端信号幅度在变压器次级侧靠近RJ45那一侧测差分信号幅度如果幅度偏低怀疑变压器插损过大或PHY发送驱动强度配置不对。有些PHY支持调整发送幅度一般在驱动寄存器里可以配置。如果幅度和眼图都不错但还是丢包查软件中断与FIFO配置。千兆网卡丢包问题很多时候其实是驱动的环形缓冲区太小或中断合并策略不当跟硬件关系不大别一头扎进Layout里出不来。5.2 症状二过EMI预扫时网口附近辐射超标现象辐射测试在125MHz或250MHz频点超标。125MHz刚好是千兆单线符号率出现这类频点超标时基本可以确定是布线或参考平面问题而不是软件误报。排查思路检查差分对与地平面的距离如果差分线离参考平面太远表层介质厚度过大辐射就会偏大。表层走线的辐射通常比内层走线大1~2个数量级所以信号完整性和EMI敏感的板子优先把千兆差分对走内层。检查变压器下方净空如果变压器下方铺铜方式不当变压器内部线圈的电场会直接辐射到PCB边缘。建议按“隔离带下方清空或严格按参考设计铺铜”来处理。检查RJ45金属壳接地多数RJ45带屏蔽外壳shield屏蔽壳要直接或通过阻容到机壳地。如果外壳悬空线缆上的共模电流会从RJ45座子直接辐射出来。这里注意屏蔽壳接地方案直接接还是通过1nF/2kV电容接取决于产品设计但绝不能不接。5.3 症状三高温老化后偶尔丢失物理链路现象高温箱里跑了几个小时网口偶尔link down然后自动恢复或者恢复后速度从1Gbps降到100Mbps。这种“半高不低”的问题最折磨人我遇到过两次。一次是PHY芯片的以太网变压器次级侧到RJ45之间的一颗共模电感虚焊。温度上来后焊点阻抗漂移共模抑制性能下降接收端误码率增加PHY自动协商降到100M。重新焊接后恢复正常。另一次是变压器中心抽头去耦电容的耐压不够高温低压下漏电增大导致共模电平偏移。这个坑比较隐蔽因为常温下没问题老化后才复发。排查建议高温现象优先做“点温”测试用热像仪看PHY附近和变压器附近的发热是否集中异常。很多隐蔽问题都是热应力引发了不良焊点或器件参数漂移。5.4 症状四量产时有千分之几的板子网口不通量产的偶发不良基本都是制造环节的问题。常见原因包括差分对钻孔偏差导致阻抗偏大/偏小板厂在制板时如果线宽线距控制不稳第一批能做准第二批就漂了。对策是要求板厂在关键层做阻抗测试条coupon出货报告里必须包含阻抗实测值和测试位置。变压器焊接偏移分离式变压器引脚间距小贴片偏移后导致开路或短路。对策是把变压器封装加长定位焊盘同时在炉后AOI里单独检查变压器本体位置。RJ45座子的金属脚虚焊这种问题外观上看不出来但插上网线时弹片接触力差时通时断。对策是要求RJ45供应商提供伸缩寿命测试报告并确保PCB上的焊盘开孔尺寸匹配座子的鱼眼/弹针结构。量产问题排查有个经验第一次拿到不良板先别急着换料调试做一次“最小化干预”——补焊所有关键引脚变压器、RJ45、PHY如果故障消失大概率是焊接问题如果故障还在再怀疑Layout或器件问题。这个方法能省很多时间。5.5 关于调试工具的一点建议调试千兆以太网口示波器带宽至少500MHz1GHz更好。如果没有差分探头可以用两个同型号探头分别接P和N然后在示波器上用数学通道做减法得到差分波形。但要注意探头本身的延迟和幅度失配会引入误差建议选用匹配好的探头对。时域反射计TDR是排查阻抗不连续的利器但一般团队不一定有。退而求其次可以用矢量网络分析仪VNA测回波损耗或者直接用PHY内部的PRBS自检模式来检测接收质量。很多千兆PHY支持回环测试Loopback配合上位机软件能快速判断链路好坏。6. 最后分享一个小经验参考设计也要带着怀疑去看很多工程师画网络接口习惯“PHY参考设计怎么画我就怎么画参考设计怎么布局我就怎么排”。这话对了一半。参考设计是芯片厂商经过验证的方案当然可信度很高但它有一个隐含前提参考设计的叠层、板材、Layout空间、滤波网络都是跟它自家的demo板绑定的。你换了一个叠层或者换了一颗变压器有一部分细节就不再适用了。比如参考设计里变压器下方铺铜但你的板子叠层更薄此时变压器下方的铺铜方式可能就需要重新评估。我的习惯是拿到参考设计后先画一个“为什么这个元件放在这里”的草图把每个去耦电容、每个匹配电阻、每段走线的目的标出来然后结合自己的叠层和结构重新布置。这样虽然前期花点时间但后面调试和量产的时候你会觉得特别有底。另外如果你用的是集成RJ45的变压器方案务必确认你选的那颗座子内部变压器的型号和PHY的匹配性。有些“万金油”座子内部集成的变压器在125MHz附近的插损偏高视觉效果上能协商上千兆但长时间高速传输时会丢包换一颗同封装但内部用更好磁芯的座子问题就消失了。千兆以太网口设计这件事本质上是把信号完整性的基本功练一遍。变压器选型解决的是“链路的下限”差分线走线解决的是“链路的上限”量产可靠性决定了你这个项目能不能真正落地。把这三个层次都做扎实你画的网口就不会再成为项目里的“玄学问题”。