1. 项目概述为什么我们要用Wireshark“窥探”PCIe的秘密握手如果你是一名硬件工程师、固件开发者或者是对计算机底层通信充满好奇的技术爱好者那么“PCIe链路训练”这个词对你来说一定不陌生。它就像是两个陌生人初次见面从互相试探、确认身份到最终建立起稳定、高速的通信通道的整个过程。这个过程发生在主板上的PCIe设备比如显卡、NVMe SSD、网卡和CPU通过Root Complex之间每次开机或设备热插拔时都会上演。然而这个过程是黑盒的、瞬态的我们通常只能通过最终的系统日志比如dmesg里显示的“link up at 5.0 GT/s”或者设备管理器里一个感叹号来知道结果——训练失败了。但失败的原因是什么是设备端没发出正确的信号还是主机端理解错了亦或是中间的某个协商环节卡住了传统的调试手段比如看寄存器、测信号完整性往往像“盲人摸象”难以全局、时序化地观察整个动态交互过程。这时我们就需要一位“协议翻译官”和“过程记录员”——Wireshark配合专业的硬件抓包工具来为我们实时捕获并解码PCIe链路层的数据包将那个神秘的握手过程一帧一帧、一个状态一个状态地呈现在我们面前。这个项目的核心价值就在于此将不可见的协议状态机LTSSM转化为可视化的、可分析的抓包数据流。通过这篇“保姆级”的图解实战你将不仅能理解LTSSM的理论状态图更能掌握如何亲手捕获这些数据、如何解读每一个关键包的含义、如何从海量的包中定位到训练失败的那个“罪魁祸首”。这对于解决实际工作中棘手的兼容性问题、降速问题、链路不稳定问题价值巨大。无论你是想深入学习PCIe协议还是急需一个强大的调试武器这篇文章都将带你从零开始完成一次完整的实战。2. 核心工具与前置知识你的“手术刀”与“解剖图”在开始“解剖”PCIe链路训练之前我们必须准备好得心应手的工具并理解我们要观察的对象的基本结构。这就像外科医生上手术台前必须熟悉手术器械和人体解剖图一样。2.1 工具选型为什么是Wireshark硬件分析仪你可能会问Wireshark不是抓网络包的吗没错但它的强大之处在于其可扩展的解码器Dissector架构。对于PCIe这种高速串行总线Wireshark本身并不能直接从主板上的金手指“嗅探”到数据。这里存在一个关键的中间角色硬件协议分析仪或带调试功能的PCIe Switch/Retimer芯片。专业硬件协议分析仪如Teledyne LeCroy、Keysight、SerialTek等厂商的产品。它们通过一个物理插槽Interposer串联在PCIe链路中无损地捕获所有链路层和数据链路层的数据包并输出为标准的PCAP文件格式。这是最直接、最权威的方法但设备通常非常昂贵。基于FPGA的抓包方案一些开源或商用的FPGA板卡如Xilinx VCU118可以实现PCIe Endpoint并内置抓包逻辑将数据通过其他接口如UART、Ethernet发送出来。成本相对较低但需要较强的FPGA开发能力。利用带镜像功能的PCIe Switch某些高端的PCIe Switch芯片如Microchip的Switchtec系列支持将指定端口的TLP事务层包和DLLP数据链路层包镜像到一个调试端口。这是很多系统厂商在研发阶段常用的方法。在本实战中我们假设你拥有一个能够生成标准PCAP文件的抓包环境。我们的重点将放在得到PCAP文件后如何用Wireshark这把“手术刀”进行深入分析。Wireshark的作用是解析和展示它需要“食材”PCAP文件而硬件分析仪就是“捕鱼器”。注意切勿尝试在普通PC上安装Wireshark直接捕获PCIe流量这是不可能的。物理层和数据链路层的操作由硬件直接处理对操作系统不可见。必须借助专门的硬件工具。2.2 知识预备快速理解LTSSM状态机LTSSMLink Training and Status State Machine是PCIe链路的“大脑”。它定义了链路从物理层通电到建立稳定连接所必须经历的一系列状态。一个简化但核心的状态流程如下Detect检测链路两端互相探测对方是否存在。就像两个人走进一间黑屋子先喊一声“有人吗”Polling轮询确认对方存在后开始交换训练序列TS1/TS2 Ordered Sets协商链路速率Gen1, Gen2, Gen3...、通道宽度x1, x4, x8, x16。这相当于互相确认“我能说多快”、“我有几个嘴巴/耳朵”。Configuration配置确定物理通道的映射关系Lane Numbering。因为PCIe是多通道Lane并行需要明确哪根线对应哪个通道编号。L0正常工作状态训练成功链路进入全功能工作状态可以传输上层的数据包TLP和链路管理包DLLP。Recovery恢复当链路出现错误或需要重新协商速率/宽度时会从L0状态退回到Recovery状态重新进行部分训练流程。其他状态如L0s、L1低功耗状态、Loopback环回测试、Hot Reset热复位等。我们的抓包目标就是捕获并识别出代表这些状态转换的有序集Ordered Set和数据链路层包DLLP。它们是LTSSM的“语言”。3. 实战环境搭建与首次抓包假设我们已经通过硬件分析仪获得了一个包含PCIe链路训练过程的PCAP文件命名为pcie_link_training.pcapng。现在让我们打开Wireshark开始真正的探索。3.1 Wireshark初始配置与插件准备首次分析PCIe数据需要对Wireshark做一些针对性设置否则你可能什么都看不到。启用PCIe协议解析Wireshark默认可能未启用所有协议解析。点击菜单栏分析 - 启用的协议。在弹出窗口的过滤框中输入“PCIe”确保PCIe和PCIe TLP等相关协议复选框被勾选。这样Wireshark才能识别并解码PCIe流量。理解捕获文件接口打开pcie_link_training.pcapng后注意看Wireshark主界面下方的状态栏。它会显示捕获来自哪个“接口”。对于硬件分析仪这里可能显示为“PCIe Analyzer Port 0”或类似信息。这有助于我们区分同时捕获的多条链路。配置显示过滤器Display Filter这是Wireshark最强大的功能之一。初始界面可能充斥着各种底层控制符号Control Symbols我们需要过滤出关键信息。一个常用的初始过滤器是pcie || ltssm || (pcie.dllp.type ! 0x00)这个过滤器会显示所有PCIe协议的数据包或者显式标记为LTSSM的包或者非空闲类型的数据链路层包DLLP。它可以帮我们快速跳过大量空闲填充数据。3.2 解读你的第一个PCIe数据包认识Ordered Set应用过滤器后你应该能看到数据包列表。找到最早时间戳的几个包。它们很可能就是TS1或TS2Ordered Set。如何识别在包列表的“协议”列你会看到PCIe。选中一个包在中间的分层详情窗口Packet Details中展开PCI Express或LTSSM部分。你应该能看到类似下面的信息Training Sequence: TS1或Training Sequence: TS2Link Number: 0Lane Number: 0Rate ID: Gen1 (2.5 GT/s)或其他速率关键字段解读Training Sequence训练序列类型。TS1和TS2是Polling和Configuration阶段的核心。简单来说两端会持续发送TS1直到收到对端的TS1然后切换为发送TS2收到对端的TS2后进入下一个状态。Link and Lane Number链路和通道号。在x1链路中它们通常都是0。在多通道链路中你会看到不同Lane Number的TS1/TS2在同时传输这是在进行通道映射。Rate ID当前协商的速率。训练总是从最低速Gen1开始成功后再尝试协商到更高的速率如Gen2、Gen3。你会看到Rate ID字段随着时间推移而变化。Symbol Lock Bit Lock在TS1/TS2的特定符号位置会有标志位指示发送端是否已完成了符号时钟同步和比特锁定。这是物理层稳定的基础。实操心得刚开始看你可能会被大量的、重复的TS1/TS2包淹没。一个技巧是使用Wireshark的“着色规则”。你可以为pcie.training.sequence 1TS1设置一种背景色如浅蓝为pcie.training.sequence 2TS2设置另一种背景色如浅绿。这样在包列表里状态切换的边界就会一目了然。4. 一步步图解LTSSM完整握手流程现在我们沿着时间线结合Wireshark的捕获数据还原一次完整的、成功的链路训练。4.1 阶段一Detect - Polling.ActiveDetect状态在物理层上电后两端发送端Tx会驱动一个特定的电气空闲Electrical Idle模式接收端Rx进行检测。这个阶段在链路层没有数据包交互因此在我们的抓包文件中这个阶段是“寂静”的看不到任何TS包。抓包文件通常从Polling阶段开始记录。进入Polling.Active一旦检测到对端存在双方立即开始发送TS1 Ordered Set。在Wireshark中你会看到从某个时间点开始突然出现了连续的、来自两个方向的TS1包。关键观察点查看TS1包中的Speed Change和Loopback等控制位。在初始Polling阶段这些位通常都是0禁用。过滤查看你可以使用过滤器pcie.training.sequence 1来只看TS1包。观察它们的Rate ID此时一定是Gen1。4.2 阶段二Polling.Active - Polling.Configuration这个转换的标志是从发送TS1切换到发送TS2。条件当一端的接收器在连续接收到8个有效的TS1序列来自对端后它就认为对端的发送器已经准备好了。动作该端会将自己的发送器从发送TS1切换为发送TS2。同时它继续检查接收到的序列。在Wireshark中观察首先你会看到两端都在持续发送TS1。接着在某一时刻一端发送的包突然从TS1变成了TS2。在包列表里你可以通过源Src和目标Dst的Lane号来区分两端。例如Lane0的TS1流中突然插入了TS2。再过一小段时间同样满足接收到8个有效TS2的条件另一端也切换为发送TS2。此时双方都在发送TS2并且接收到对端的TS2。这标志着Polling.Configuration子状态的开始。使用IO Graph可视化为了更直观地看到切换你可以打开Wireshark的统计 - IO图表。添加两条曲线过滤器1:pcie.training.sequence 1 pcie.lane 0 绘制风格为“条形图”颜色红色。这表示Lane0上出现的TS1。过滤器2:pcie.training.sequence 2 pcie.lane 0 绘制风格为“条形图”颜色绿色。这表示Lane0上出现的TS2。 图表会清晰显示红色条先出现然后红色停止、绿色条出现的时间点这就是状态切换的时刻。4.3 阶段三Configuration - L0这是最复杂的一步尤其是对于多通道x4, x8, x16链路。其核心任务是通道映射Lane Reversal和通道编号分配Lane Numbering。交换通道映射信息在Configuration状态下发送的TS2 Ordered Set中包含了Link Number和Lane Number字段。对于x1链路这很简单都是0。对于多通道链路上游端口Root Port会为每个物理通道分配一个逻辑链路号通常为0和逻辑通道号0,1,2,3...。下游设备Endpoint会接收这些信息并可能根据自己内部的布线可能存在通道反转进行映射再通过自己发出的TS2包告知上游。在Wireshark中观察多通道训练你需要同时观察多个Lane例如Lane0, Lane1, Lane2, Lane3的抓包数据。硬件分析仪通常能同时捕获所有通道。使用过滤器pcie.training.sequence 2查看所有TS2。在Packet Details中对比不同Lane上TS2包的Transmitted Link Number和Transmitted Lane Number。你会看到上游设备发送的TS2中每个物理Lane的Transmitted Lane Number是递增且唯一的0,1,2,3。下游设备回复的TS2中其Transmitted Lane Number可能顺序相同也可能 reversed3,2,1,0这取决于硬件布线。关键点当两端在各自所有通道上都连续收到8个Transmitted Lane Number稳定且符合映射关系的TS2后就认为通道映射完成。进入L0状态通道映射完成后两端停止发送TS2并开始发送SKP Ordered Set用于时钟容差补偿和正常的数据链路层包DLLP以及事务层包TLP。在Wireshark中的标志TS2的流突然停止了。取而代之的是协议列为PCIe TLP或PCIe DLLP的包。你可能会先看到一些DLLP: InitFC1(初始化流量控制) 和DLLP: InitFC2的包这是链路进入L0后首先要进行的流量控制初始化。随后你就可以看到上层应用产生的TLP了例如Memory Read Request,Completion with Data等。这标志着链路已经完全就绪可以正常工作。4.4 速率切换Optional如果双方支持并协商了高于Gen1的速率如Gen2在进入L0后链路可能会很快进入Recovery状态进行速率切换。触发在L0状态下一端会发送一个带有Speed Change标志位的DLLP通常是PM_Enter_L1或特定的TrainingDLLP。过程链路退回Recovery状态重新进行Polling和Configuration但这次TS1/TS2中的Rate ID字段会指示更高的目标速率如Gen2。观察在抓包中你会看到在TLP/DLLP流中断后重新出现TS1流并且其Rate ID变成了Gen2 (5.0 GT/s)。成功后链路再次回到L0继续传输数据。这个过程可能会重复直到达到双方支持的最高速率。5. 故障排查实战当握手失败时Wireshark告诉我们什么理论上的成功流程固然美好但实战的价值更多体现在排查故障上。下面我们看几个典型的失败场景以及如何在Wireshark中定位问题。5.1 案例一链路卡在Polling状态无法升级到Configuration现象系统日志显示链路训练超时设备无法识别。抓包显示两端一直在无穷无尽地互相发送TS1从未出现TS2。Wireshark分析步骤确认双向流量首先确保你能看到来自两个方向的TS1。使用过滤器pcie.training.sequence 1然后看包的源和目标Lane。应该有两个不同的源地址在持续发送TS1。如果只有单向流量那问题可能是物理层连接故障如一根Lane没接好。检查TS1内容仔细对比两端发出的TS1内容。重点检查Rate ID是否一致一端是否错误地配置为从Gen2开始训练(虽然协议要求从Gen1开始但错误配置可能导致)。控制位是否异常检查Loopback,Disable Link,Hot Reset等位。如果有一方意外地将Disable Link置位训练就会停止。电气空闲检测虽然抓包看不到但如果一方Tx发送TS1但另一方Rx由于信号完整性问题损耗、串扰根本无法识别出有效的TS1序列那么接收方就不会满足“连续收到8个有效TS1”的条件也就不会切换至发送TS2。间接证据观察接收方发出的TS1其Symbol Lock和Bit Lock标志位可能一直为0表示接收器从未成功锁定发送器的信号。排查思路这种情况大概率是物理层问题或基础配置严重不匹配。应优先检查硬件连接、供电、参考时钟以及设备的基本配置寄存器如Link Capabilities。5.2 案例二Configuration阶段失败通道映射混乱现象训练在Configuration阶段失败系统可能只识别到部分通道如x16的显卡只运行在x8模式。抓包显示TS2流出现但持续一段时间后链路复位重新开始Detect。Wireshark分析步骤观察所有Lane的TS2为每个物理Lane如0,1,...,15创建显示过滤器分别查看pcie.training.sequence 2 pcie.lane 0pcie.training.sequence 2 pcie.lane 1...对比映射关系创建一个表格记录每个物理Lane上来自上游RC和下游EP的TS2包中的Transmitted Link Number (LN)和Transmitted Lane Number (N)。物理LaneRC发送的TS2 (LN, N)EP发送的TS2 (LN, N)备注0(0, 0)(0, 15)疑似反转1(0, 1)(0, 14)疑似反转............15(0, 15)(0, 0)疑似反转分析上表显示了一个典型的通道反转Lane Reversal情况。EP把接收到的Lane顺序完全反了过来。这本身是协议允许的只要映射关系一致即可。问题可能出在非对称反转如果只有部分Lane的映射看起来是混乱的而不是完美的对称反转那可能是硬件PCB布线错误。Link Number不匹配如果RC发送的Link Number是0而EP回复的Link Number是其他值说明EP可能配置为多功能设备或虚拟桥链路号协商错误。TS2流中断如果某个Lane上的TS2流突然中断比如只发了几个包就停了而其他Lane正常可能是该Lane的信号质量在Configuration阶段恶化导致接收端无法持续收到有效TS2。排查思路重点检查硬件设计特别是多通道的PCB走线等长、间距是否符合规范。同时检查EP设备的固件或配置空间看其关于通道宽度和反转的配置是否正确。5.3 案例三速率协商Recovery失败现象链路能在Gen1速率下正常进入L0但一旦尝试切换到更高速率如Gen2链路就断开设备降速运行或消失。Wireshark分析步骤定位速率切换点使用过滤器pcie.training.sequence 1 || pcie.training.sequence 2查看所有训练序列。找到从Gen1的L0状态之后再次出现的TS1包。检查速率标识查看这些“第二轮”TS1和TS2的Rate ID字段。它应该显示目标更高速率如Gen2。观察结果场景ATS1/TS2流在Gen2下持续一段时间然后整个链路复位重新从Detect开始。这通常表明在更高速率下物理层信号质量不达标眼图闭合、抖动过大导致接收端无法稳定锁定信号。场景B根本没有出现Gen2的TS1/TS2流。这可能表明一端根本没有发起速率切换请求检查RC和EP的Link Control 2寄存器中的Target Link Speed字段。速率切换的DLLP请求在传输中丢失可能性较低。排查思路这几乎是纯信号完整性SI问题。需要使用示波器或误码仪BERT在目标速率下测试链路的眼图、抖动、损耗等参数。同时检查主板和设备的参考时钟质量因为更高速率对时钟要求更苛刻。6. 高级技巧与长期分析策略掌握了基础流程和故障排查后一些高级技巧能让你事半功倍。6.1 使用Wireshark着色规则和配置文件针对PCIe分析创建一套自己的着色规则和配置文件可以极大提升效率。着色规则pcie.training.sequence 1浅蓝色背景 - 快速识别Polling阶段。pcie.training.sequence 2浅绿色背景 - 快速识别Configuration阶段。pcie.dllp.type 0x20黄色背景 - 高亮显示“InitFC1” DLLP这是进入L0的标志之一。pcie.tlp灰色背景 - 区分上层数据流量。配置文件将设置好的着色规则、列显示如增加“Rate ID”、“Lane Number”列、常用过滤器保存为一个新的Wireshark配置文件配置文件 - 新建下次分析时直接加载。6.2 编写LTSSM状态跟踪显示过滤器我们可以利用Wireshark的显示过滤器逻辑近似地“模拟”LTSSM状态机在抓包文件中的演进。-- 假设我们只分析Lane 0 -- Detect: 无包可滤是寂静期 -- Polling.Active: 只有TS1没有TS2 (pcie.lane 0 pcie.training.sequence 1) !(pcie.lane 0 pcie.training.sequence 2) -- Polling.Configuration: 出现了TS2意味着至少一端开始发TS2 (pcie.lane 0 pcie.training.sequence 2) -- 进入L0: TS1/TS2流停止出现DLLP或TLP这里用InitFC1 DLLP作为标志 (pcie.lane 0 pcie.dllp.type 0x20) -- Recovery for Speed Change: 在L0流量后重新出现TS1且Rate ID变化 (pcie.lane 0 pcie.training.sequence 1) (frame.number [L0出现后的最后一个帧号]) (pcie.rate_id ! [之前的Rate ID值])通过依次应用这些过滤器你可以在时间线上“步进”式地观察链路状态的变化。6.3 结合系统日志与寄存器快照进行联合调试抓包不是孤立的。最强大的调试方式是时间关联。同步时间戳如果可能配置你的硬件分析仪和待测系统通过串口日志、IPMI等使用相同的时间源如NTP或至少在日志中记录关键事件如“开始枚举PCIe设备”的精确时间。触发抓拍在系统侧触发一个事件如复位设备、加载驱动的同时手动触发协议分析仪开始捕获。这样你就能在抓包文件中精确找到对应系统事件发生的时刻点。关联分析当你在系统日志中看到“PCIe link training failed”时立刻去抓包文件中对应的时间点附近分析TS1/TS2的交互情况。同时如果可能通过调试工具如PCIe配置空间访问工具在训练失败后立刻抓取设备的Link Status、Link Control等寄存器与抓包信息相互印证。7. 总结与核心要点回顾通过这次从工具准备到实战抓包再到故障排查的完整旅程你应该已经深刻体会到Wireshark配合硬件分析仪是如何将PCIe链路训练这个抽象的、毫秒级的状态机变成一份可供我们反复审视、逐帧分析的“诊断报告”的。核心收获三点 第一LTSSM的每个状态在物理层都有其对应的数据包表现形式。Detect是寂静Polling是TS1/TS2的切换舞步Configuration是TS2中通道编号的交换L0是DLLP和TLP的欢快流淌。抓住这些特征包就抓住了状态机的脉搏。 第二故障排查必须结合双向流量和时序。只看一端的数据如同盲人摸象。一定要对比链路上行和下行两个方向的数据流观察它们之间的因果关系和时序间隔。一个状态的转换永远是一方先行动另一方响应。 第三Wireshark是展示窗口根源常在物理层和配置层。抓包能精准地告诉你“谈判在哪一步破裂了”但破裂的原因多半是信号质量不达标、硬件连接故障、或寄存器配置错误。抓包指明了方向最终的修复往往需要硬件工程师、驱动工程师的协同。最后分享一个我自己的习惯对于任何一次重要的PCIe调试我都会保存完整的抓包文件并用清晰的命名归档例如EP_Gen4_Card_Fail_At_Polling_20231027.pcapng。在文件中我会用Wireshark的“添加分组注释”功能在关键的状态转换包上做标记。时间久了这就形成了一个宝贵的故障案例库下次再遇到类似问题翻出来对比一下往往能瞬间打开思路。调试的功夫一半在当下一半在平日的积累。希望这篇图解实战能成为你积累路上的一块有用的垫脚石。
Wireshark实战：图解PCIe链路训练与LTSSM状态机调试
发布时间：2026/7/4 22:42:26
1. 项目概述为什么我们要用Wireshark“窥探”PCIe的秘密握手如果你是一名硬件工程师、固件开发者或者是对计算机底层通信充满好奇的技术爱好者那么“PCIe链路训练”这个词对你来说一定不陌生。它就像是两个陌生人初次见面从互相试探、确认身份到最终建立起稳定、高速的通信通道的整个过程。这个过程发生在主板上的PCIe设备比如显卡、NVMe SSD、网卡和CPU通过Root Complex之间每次开机或设备热插拔时都会上演。然而这个过程是黑盒的、瞬态的我们通常只能通过最终的系统日志比如dmesg里显示的“link up at 5.0 GT/s”或者设备管理器里一个感叹号来知道结果——训练失败了。但失败的原因是什么是设备端没发出正确的信号还是主机端理解错了亦或是中间的某个协商环节卡住了传统的调试手段比如看寄存器、测信号完整性往往像“盲人摸象”难以全局、时序化地观察整个动态交互过程。这时我们就需要一位“协议翻译官”和“过程记录员”——Wireshark配合专业的硬件抓包工具来为我们实时捕获并解码PCIe链路层的数据包将那个神秘的握手过程一帧一帧、一个状态一个状态地呈现在我们面前。这个项目的核心价值就在于此将不可见的协议状态机LTSSM转化为可视化的、可分析的抓包数据流。通过这篇“保姆级”的图解实战你将不仅能理解LTSSM的理论状态图更能掌握如何亲手捕获这些数据、如何解读每一个关键包的含义、如何从海量的包中定位到训练失败的那个“罪魁祸首”。这对于解决实际工作中棘手的兼容性问题、降速问题、链路不稳定问题价值巨大。无论你是想深入学习PCIe协议还是急需一个强大的调试武器这篇文章都将带你从零开始完成一次完整的实战。2. 核心工具与前置知识你的“手术刀”与“解剖图”在开始“解剖”PCIe链路训练之前我们必须准备好得心应手的工具并理解我们要观察的对象的基本结构。这就像外科医生上手术台前必须熟悉手术器械和人体解剖图一样。2.1 工具选型为什么是Wireshark硬件分析仪你可能会问Wireshark不是抓网络包的吗没错但它的强大之处在于其可扩展的解码器Dissector架构。对于PCIe这种高速串行总线Wireshark本身并不能直接从主板上的金手指“嗅探”到数据。这里存在一个关键的中间角色硬件协议分析仪或带调试功能的PCIe Switch/Retimer芯片。专业硬件协议分析仪如Teledyne LeCroy、Keysight、SerialTek等厂商的产品。它们通过一个物理插槽Interposer串联在PCIe链路中无损地捕获所有链路层和数据链路层的数据包并输出为标准的PCAP文件格式。这是最直接、最权威的方法但设备通常非常昂贵。基于FPGA的抓包方案一些开源或商用的FPGA板卡如Xilinx VCU118可以实现PCIe Endpoint并内置抓包逻辑将数据通过其他接口如UART、Ethernet发送出来。成本相对较低但需要较强的FPGA开发能力。利用带镜像功能的PCIe Switch某些高端的PCIe Switch芯片如Microchip的Switchtec系列支持将指定端口的TLP事务层包和DLLP数据链路层包镜像到一个调试端口。这是很多系统厂商在研发阶段常用的方法。在本实战中我们假设你拥有一个能够生成标准PCAP文件的抓包环境。我们的重点将放在得到PCAP文件后如何用Wireshark这把“手术刀”进行深入分析。Wireshark的作用是解析和展示它需要“食材”PCAP文件而硬件分析仪就是“捕鱼器”。注意切勿尝试在普通PC上安装Wireshark直接捕获PCIe流量这是不可能的。物理层和数据链路层的操作由硬件直接处理对操作系统不可见。必须借助专门的硬件工具。2.2 知识预备快速理解LTSSM状态机LTSSMLink Training and Status State Machine是PCIe链路的“大脑”。它定义了链路从物理层通电到建立稳定连接所必须经历的一系列状态。一个简化但核心的状态流程如下Detect检测链路两端互相探测对方是否存在。就像两个人走进一间黑屋子先喊一声“有人吗”Polling轮询确认对方存在后开始交换训练序列TS1/TS2 Ordered Sets协商链路速率Gen1, Gen2, Gen3...、通道宽度x1, x4, x8, x16。这相当于互相确认“我能说多快”、“我有几个嘴巴/耳朵”。Configuration配置确定物理通道的映射关系Lane Numbering。因为PCIe是多通道Lane并行需要明确哪根线对应哪个通道编号。L0正常工作状态训练成功链路进入全功能工作状态可以传输上层的数据包TLP和链路管理包DLLP。Recovery恢复当链路出现错误或需要重新协商速率/宽度时会从L0状态退回到Recovery状态重新进行部分训练流程。其他状态如L0s、L1低功耗状态、Loopback环回测试、Hot Reset热复位等。我们的抓包目标就是捕获并识别出代表这些状态转换的有序集Ordered Set和数据链路层包DLLP。它们是LTSSM的“语言”。3. 实战环境搭建与首次抓包假设我们已经通过硬件分析仪获得了一个包含PCIe链路训练过程的PCAP文件命名为pcie_link_training.pcapng。现在让我们打开Wireshark开始真正的探索。3.1 Wireshark初始配置与插件准备首次分析PCIe数据需要对Wireshark做一些针对性设置否则你可能什么都看不到。启用PCIe协议解析Wireshark默认可能未启用所有协议解析。点击菜单栏分析 - 启用的协议。在弹出窗口的过滤框中输入“PCIe”确保PCIe和PCIe TLP等相关协议复选框被勾选。这样Wireshark才能识别并解码PCIe流量。理解捕获文件接口打开pcie_link_training.pcapng后注意看Wireshark主界面下方的状态栏。它会显示捕获来自哪个“接口”。对于硬件分析仪这里可能显示为“PCIe Analyzer Port 0”或类似信息。这有助于我们区分同时捕获的多条链路。配置显示过滤器Display Filter这是Wireshark最强大的功能之一。初始界面可能充斥着各种底层控制符号Control Symbols我们需要过滤出关键信息。一个常用的初始过滤器是pcie || ltssm || (pcie.dllp.type ! 0x00)这个过滤器会显示所有PCIe协议的数据包或者显式标记为LTSSM的包或者非空闲类型的数据链路层包DLLP。它可以帮我们快速跳过大量空闲填充数据。3.2 解读你的第一个PCIe数据包认识Ordered Set应用过滤器后你应该能看到数据包列表。找到最早时间戳的几个包。它们很可能就是TS1或TS2Ordered Set。如何识别在包列表的“协议”列你会看到PCIe。选中一个包在中间的分层详情窗口Packet Details中展开PCI Express或LTSSM部分。你应该能看到类似下面的信息Training Sequence: TS1或Training Sequence: TS2Link Number: 0Lane Number: 0Rate ID: Gen1 (2.5 GT/s)或其他速率关键字段解读Training Sequence训练序列类型。TS1和TS2是Polling和Configuration阶段的核心。简单来说两端会持续发送TS1直到收到对端的TS1然后切换为发送TS2收到对端的TS2后进入下一个状态。Link and Lane Number链路和通道号。在x1链路中它们通常都是0。在多通道链路中你会看到不同Lane Number的TS1/TS2在同时传输这是在进行通道映射。Rate ID当前协商的速率。训练总是从最低速Gen1开始成功后再尝试协商到更高的速率如Gen2、Gen3。你会看到Rate ID字段随着时间推移而变化。Symbol Lock Bit Lock在TS1/TS2的特定符号位置会有标志位指示发送端是否已完成了符号时钟同步和比特锁定。这是物理层稳定的基础。实操心得刚开始看你可能会被大量的、重复的TS1/TS2包淹没。一个技巧是使用Wireshark的“着色规则”。你可以为pcie.training.sequence 1TS1设置一种背景色如浅蓝为pcie.training.sequence 2TS2设置另一种背景色如浅绿。这样在包列表里状态切换的边界就会一目了然。4. 一步步图解LTSSM完整握手流程现在我们沿着时间线结合Wireshark的捕获数据还原一次完整的、成功的链路训练。4.1 阶段一Detect - Polling.ActiveDetect状态在物理层上电后两端发送端Tx会驱动一个特定的电气空闲Electrical Idle模式接收端Rx进行检测。这个阶段在链路层没有数据包交互因此在我们的抓包文件中这个阶段是“寂静”的看不到任何TS包。抓包文件通常从Polling阶段开始记录。进入Polling.Active一旦检测到对端存在双方立即开始发送TS1 Ordered Set。在Wireshark中你会看到从某个时间点开始突然出现了连续的、来自两个方向的TS1包。关键观察点查看TS1包中的Speed Change和Loopback等控制位。在初始Polling阶段这些位通常都是0禁用。过滤查看你可以使用过滤器pcie.training.sequence 1来只看TS1包。观察它们的Rate ID此时一定是Gen1。4.2 阶段二Polling.Active - Polling.Configuration这个转换的标志是从发送TS1切换到发送TS2。条件当一端的接收器在连续接收到8个有效的TS1序列来自对端后它就认为对端的发送器已经准备好了。动作该端会将自己的发送器从发送TS1切换为发送TS2。同时它继续检查接收到的序列。在Wireshark中观察首先你会看到两端都在持续发送TS1。接着在某一时刻一端发送的包突然从TS1变成了TS2。在包列表里你可以通过源Src和目标Dst的Lane号来区分两端。例如Lane0的TS1流中突然插入了TS2。再过一小段时间同样满足接收到8个有效TS2的条件另一端也切换为发送TS2。此时双方都在发送TS2并且接收到对端的TS2。这标志着Polling.Configuration子状态的开始。使用IO Graph可视化为了更直观地看到切换你可以打开Wireshark的统计 - IO图表。添加两条曲线过滤器1:pcie.training.sequence 1 pcie.lane 0 绘制风格为“条形图”颜色红色。这表示Lane0上出现的TS1。过滤器2:pcie.training.sequence 2 pcie.lane 0 绘制风格为“条形图”颜色绿色。这表示Lane0上出现的TS2。 图表会清晰显示红色条先出现然后红色停止、绿色条出现的时间点这就是状态切换的时刻。4.3 阶段三Configuration - L0这是最复杂的一步尤其是对于多通道x4, x8, x16链路。其核心任务是通道映射Lane Reversal和通道编号分配Lane Numbering。交换通道映射信息在Configuration状态下发送的TS2 Ordered Set中包含了Link Number和Lane Number字段。对于x1链路这很简单都是0。对于多通道链路上游端口Root Port会为每个物理通道分配一个逻辑链路号通常为0和逻辑通道号0,1,2,3...。下游设备Endpoint会接收这些信息并可能根据自己内部的布线可能存在通道反转进行映射再通过自己发出的TS2包告知上游。在Wireshark中观察多通道训练你需要同时观察多个Lane例如Lane0, Lane1, Lane2, Lane3的抓包数据。硬件分析仪通常能同时捕获所有通道。使用过滤器pcie.training.sequence 2查看所有TS2。在Packet Details中对比不同Lane上TS2包的Transmitted Link Number和Transmitted Lane Number。你会看到上游设备发送的TS2中每个物理Lane的Transmitted Lane Number是递增且唯一的0,1,2,3。下游设备回复的TS2中其Transmitted Lane Number可能顺序相同也可能 reversed3,2,1,0这取决于硬件布线。关键点当两端在各自所有通道上都连续收到8个Transmitted Lane Number稳定且符合映射关系的TS2后就认为通道映射完成。进入L0状态通道映射完成后两端停止发送TS2并开始发送SKP Ordered Set用于时钟容差补偿和正常的数据链路层包DLLP以及事务层包TLP。在Wireshark中的标志TS2的流突然停止了。取而代之的是协议列为PCIe TLP或PCIe DLLP的包。你可能会先看到一些DLLP: InitFC1(初始化流量控制) 和DLLP: InitFC2的包这是链路进入L0后首先要进行的流量控制初始化。随后你就可以看到上层应用产生的TLP了例如Memory Read Request,Completion with Data等。这标志着链路已经完全就绪可以正常工作。4.4 速率切换Optional如果双方支持并协商了高于Gen1的速率如Gen2在进入L0后链路可能会很快进入Recovery状态进行速率切换。触发在L0状态下一端会发送一个带有Speed Change标志位的DLLP通常是PM_Enter_L1或特定的TrainingDLLP。过程链路退回Recovery状态重新进行Polling和Configuration但这次TS1/TS2中的Rate ID字段会指示更高的目标速率如Gen2。观察在抓包中你会看到在TLP/DLLP流中断后重新出现TS1流并且其Rate ID变成了Gen2 (5.0 GT/s)。成功后链路再次回到L0继续传输数据。这个过程可能会重复直到达到双方支持的最高速率。5. 故障排查实战当握手失败时Wireshark告诉我们什么理论上的成功流程固然美好但实战的价值更多体现在排查故障上。下面我们看几个典型的失败场景以及如何在Wireshark中定位问题。5.1 案例一链路卡在Polling状态无法升级到Configuration现象系统日志显示链路训练超时设备无法识别。抓包显示两端一直在无穷无尽地互相发送TS1从未出现TS2。Wireshark分析步骤确认双向流量首先确保你能看到来自两个方向的TS1。使用过滤器pcie.training.sequence 1然后看包的源和目标Lane。应该有两个不同的源地址在持续发送TS1。如果只有单向流量那问题可能是物理层连接故障如一根Lane没接好。检查TS1内容仔细对比两端发出的TS1内容。重点检查Rate ID是否一致一端是否错误地配置为从Gen2开始训练(虽然协议要求从Gen1开始但错误配置可能导致)。控制位是否异常检查Loopback,Disable Link,Hot Reset等位。如果有一方意外地将Disable Link置位训练就会停止。电气空闲检测虽然抓包看不到但如果一方Tx发送TS1但另一方Rx由于信号完整性问题损耗、串扰根本无法识别出有效的TS1序列那么接收方就不会满足“连续收到8个有效TS1”的条件也就不会切换至发送TS2。间接证据观察接收方发出的TS1其Symbol Lock和Bit Lock标志位可能一直为0表示接收器从未成功锁定发送器的信号。排查思路这种情况大概率是物理层问题或基础配置严重不匹配。应优先检查硬件连接、供电、参考时钟以及设备的基本配置寄存器如Link Capabilities。5.2 案例二Configuration阶段失败通道映射混乱现象训练在Configuration阶段失败系统可能只识别到部分通道如x16的显卡只运行在x8模式。抓包显示TS2流出现但持续一段时间后链路复位重新开始Detect。Wireshark分析步骤观察所有Lane的TS2为每个物理Lane如0,1,...,15创建显示过滤器分别查看pcie.training.sequence 2 pcie.lane 0pcie.training.sequence 2 pcie.lane 1...对比映射关系创建一个表格记录每个物理Lane上来自上游RC和下游EP的TS2包中的Transmitted Link Number (LN)和Transmitted Lane Number (N)。物理LaneRC发送的TS2 (LN, N)EP发送的TS2 (LN, N)备注0(0, 0)(0, 15)疑似反转1(0, 1)(0, 14)疑似反转............15(0, 15)(0, 0)疑似反转分析上表显示了一个典型的通道反转Lane Reversal情况。EP把接收到的Lane顺序完全反了过来。这本身是协议允许的只要映射关系一致即可。问题可能出在非对称反转如果只有部分Lane的映射看起来是混乱的而不是完美的对称反转那可能是硬件PCB布线错误。Link Number不匹配如果RC发送的Link Number是0而EP回复的Link Number是其他值说明EP可能配置为多功能设备或虚拟桥链路号协商错误。TS2流中断如果某个Lane上的TS2流突然中断比如只发了几个包就停了而其他Lane正常可能是该Lane的信号质量在Configuration阶段恶化导致接收端无法持续收到有效TS2。排查思路重点检查硬件设计特别是多通道的PCB走线等长、间距是否符合规范。同时检查EP设备的固件或配置空间看其关于通道宽度和反转的配置是否正确。5.3 案例三速率协商Recovery失败现象链路能在Gen1速率下正常进入L0但一旦尝试切换到更高速率如Gen2链路就断开设备降速运行或消失。Wireshark分析步骤定位速率切换点使用过滤器pcie.training.sequence 1 || pcie.training.sequence 2查看所有训练序列。找到从Gen1的L0状态之后再次出现的TS1包。检查速率标识查看这些“第二轮”TS1和TS2的Rate ID字段。它应该显示目标更高速率如Gen2。观察结果场景ATS1/TS2流在Gen2下持续一段时间然后整个链路复位重新从Detect开始。这通常表明在更高速率下物理层信号质量不达标眼图闭合、抖动过大导致接收端无法稳定锁定信号。场景B根本没有出现Gen2的TS1/TS2流。这可能表明一端根本没有发起速率切换请求检查RC和EP的Link Control 2寄存器中的Target Link Speed字段。速率切换的DLLP请求在传输中丢失可能性较低。排查思路这几乎是纯信号完整性SI问题。需要使用示波器或误码仪BERT在目标速率下测试链路的眼图、抖动、损耗等参数。同时检查主板和设备的参考时钟质量因为更高速率对时钟要求更苛刻。6. 高级技巧与长期分析策略掌握了基础流程和故障排查后一些高级技巧能让你事半功倍。6.1 使用Wireshark着色规则和配置文件针对PCIe分析创建一套自己的着色规则和配置文件可以极大提升效率。着色规则pcie.training.sequence 1浅蓝色背景 - 快速识别Polling阶段。pcie.training.sequence 2浅绿色背景 - 快速识别Configuration阶段。pcie.dllp.type 0x20黄色背景 - 高亮显示“InitFC1” DLLP这是进入L0的标志之一。pcie.tlp灰色背景 - 区分上层数据流量。配置文件将设置好的着色规则、列显示如增加“Rate ID”、“Lane Number”列、常用过滤器保存为一个新的Wireshark配置文件配置文件 - 新建下次分析时直接加载。6.2 编写LTSSM状态跟踪显示过滤器我们可以利用Wireshark的显示过滤器逻辑近似地“模拟”LTSSM状态机在抓包文件中的演进。-- 假设我们只分析Lane 0 -- Detect: 无包可滤是寂静期 -- Polling.Active: 只有TS1没有TS2 (pcie.lane 0 pcie.training.sequence 1) !(pcie.lane 0 pcie.training.sequence 2) -- Polling.Configuration: 出现了TS2意味着至少一端开始发TS2 (pcie.lane 0 pcie.training.sequence 2) -- 进入L0: TS1/TS2流停止出现DLLP或TLP这里用InitFC1 DLLP作为标志 (pcie.lane 0 pcie.dllp.type 0x20) -- Recovery for Speed Change: 在L0流量后重新出现TS1且Rate ID变化 (pcie.lane 0 pcie.training.sequence 1) (frame.number [L0出现后的最后一个帧号]) (pcie.rate_id ! [之前的Rate ID值])通过依次应用这些过滤器你可以在时间线上“步进”式地观察链路状态的变化。6.3 结合系统日志与寄存器快照进行联合调试抓包不是孤立的。最强大的调试方式是时间关联。同步时间戳如果可能配置你的硬件分析仪和待测系统通过串口日志、IPMI等使用相同的时间源如NTP或至少在日志中记录关键事件如“开始枚举PCIe设备”的精确时间。触发抓拍在系统侧触发一个事件如复位设备、加载驱动的同时手动触发协议分析仪开始捕获。这样你就能在抓包文件中精确找到对应系统事件发生的时刻点。关联分析当你在系统日志中看到“PCIe link training failed”时立刻去抓包文件中对应的时间点附近分析TS1/TS2的交互情况。同时如果可能通过调试工具如PCIe配置空间访问工具在训练失败后立刻抓取设备的Link Status、Link Control等寄存器与抓包信息相互印证。7. 总结与核心要点回顾通过这次从工具准备到实战抓包再到故障排查的完整旅程你应该已经深刻体会到Wireshark配合硬件分析仪是如何将PCIe链路训练这个抽象的、毫秒级的状态机变成一份可供我们反复审视、逐帧分析的“诊断报告”的。核心收获三点 第一LTSSM的每个状态在物理层都有其对应的数据包表现形式。Detect是寂静Polling是TS1/TS2的切换舞步Configuration是TS2中通道编号的交换L0是DLLP和TLP的欢快流淌。抓住这些特征包就抓住了状态机的脉搏。 第二故障排查必须结合双向流量和时序。只看一端的数据如同盲人摸象。一定要对比链路上行和下行两个方向的数据流观察它们之间的因果关系和时序间隔。一个状态的转换永远是一方先行动另一方响应。 第三Wireshark是展示窗口根源常在物理层和配置层。抓包能精准地告诉你“谈判在哪一步破裂了”但破裂的原因多半是信号质量不达标、硬件连接故障、或寄存器配置错误。抓包指明了方向最终的修复往往需要硬件工程师、驱动工程师的协同。最后分享一个我自己的习惯对于任何一次重要的PCIe调试我都会保存完整的抓包文件并用清晰的命名归档例如EP_Gen4_Card_Fail_At_Polling_20231027.pcapng。在文件中我会用Wireshark的“添加分组注释”功能在关键的状态转换包上做标记。时间久了这就形成了一个宝贵的故障案例库下次再遇到类似问题翻出来对比一下往往能瞬间打开思路。调试的功夫一半在当下一半在平日的积累。希望这篇图解实战能成为你积累路上的一块有用的垫脚石。
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